Basisboard für TE0955

TEB0955 - 10.5 x 15 cm carrier

TEB0955 - Wiki with TRM, reference projects, application notes and more
- TEB0955 TRM - TBD Technical Reference Manual
- TEB0955 PCN - PCN (see also Schematic Change History and TRM)
4 x 5.64 ADM6/ADF6 B2B Connectors - overview, compatibility, mating heights and speed rating

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Pinout/Tracelength Table - illustration of pinout, tracelength and cross reference Information of modules with different baseboards

Support

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File	File-Extension	Description
Bit-File	*.bit	FPGA Configuration File
Diverse Reports	--	Report files in different formats

Dateien	Datei-Endung	Beschreibung
MCS-File	*.mcs	Flash Konfigurationsdatei mit Boot-Image (MicroBlaze oder nur FPGA-Teil)
Bit-File	*.bit	FPGA Konfigurationsdatei
Software-Application-File	*.elf	Software Anwendung für Zynq or MicroBlaze Processor Systeme
Hardware-Platform-Specification-Files	*.hdf	Hardware Specification vom the Vivado Project für SDK/HSI
MMI-File	*.mmi	Datei mit Beschreibung der BRAM-Location für die MCS- oder BIT-File Generierung mit *.elf Inhalt (MicroBlaze)
Diverse Reports	--	Report-Dateien in verschiedenen Formaten

Komponente	Beschreibung
Xilinx-IP	I2C,SPI-Flash,UART
TE-IP	ASIO (AXI-Stream to IO)

Dateien	Datei-Endung	Beschreibung
MCS-File	*.mcs	Flash Konfigurationsdatei mit Boot-Image (MicroBlaze oder nur FPGA-Teil)
BIT-File	*.bit	FPGA Konfigurationsdatei
Software-Application-File	*.elf	Software Anwendung für Zynq oder MicroBlaze Processor Systeme
Hardware-Platform-Specification-Files	*.hdf	Exportierte Vivado Hardware Specification für SDK/HSI
MMI-File	*.mmi	Datei mit Beschreibung der BRAM-Location für die MCS- oder BIT-File Generierung mit *.elf Inhalt (MicroBlaze)
Diverse Reports	--	Report-Dateien in verschiedenen Formaten

Komponente	Beschreibung
Xilinx-IP	VIO
TE-IP	Startupe2,LabTools Frequency Counter

Komponente	Beschreibung
Xilinx-IP	VIO (Virtual Input/Output)
TE-IP	Labtools Frequency Counter, Startupe2 Primitive Wrapper

Komponente	Beschreibung
Xilinx-IP	MicroBlaze, MB-Debug, Uartlite, MIG7 for DDR3, QSPI, Timer, Ethernet Lite
TE-IP	ASIO GPIO (AXI-Stream to GPIO)

Komponente	Beschreibung
Xilinx-IP	ILA, VIO, CLK-Wizard
TE-IP	F32C, Vector_LED, UART_MON

Komponente	Beschreibung
Xilinx-IP	AXI Timer, AXI Interrupt Controller,MIG, AXI QSPI, AXI Uart Lite, AXI I2C, AXI Ethernet Lite, VIO
TE-IP	ASIO (AXI-Stream to IO), labtools_fmeter

Basisboard für TE0955

Produktinformationen "Basisboard für TE0955"

Eigenschaften

Lieferumfang TE0955-02-EGBE32AS Starter Kit

Zusätzliche Informationen

Downloads

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CR00100 Basic Beispiel

CR00100 Basic Beispiel

CR00103 Hyperram Citrobits

CR00103 Test Certus

CR00107 Basic Hello World Beispiel

TE0802 Basic Linux Beispiel

TE0802 Basic Linux Beispiel

TE0802 Basic Linux Beispiel

TE0802 Basic Linux Beispiel

Vitis AI Referenz Design

TE0950 Basic Linux Beispiel

TE0950 Basic Linux Beispiel

TEI0022 Basic Beispiel

TEI0022 Basic Beispiel

TE0717 Hello World Beispiel

TEI0001 Basic Beispiel

TEI0001 Basic Beispiel

TEI0001 Basic Beispiel

TEI0001 Basic Beispiel

TEI0001 Basic Beispiel

TEI0001 Basic Beispiel

TEI0003 LED Sequencer Beispiel

TEI0003 NIOS SDRAM Beispiel

TEI0003 Basic Beispiel

TEI0003 Basic Beispiel

TEI0003 Basic Beispiel

TEI0003 Basic Beispiel

TEI0003 Basic Beispiel

TEI0010 Basic Beispiel

TEI0010 Basic Beispiel

TEI0010 Basic Beispiel

TEI0010 Basic Beispiel

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TEI0050 Basic Beispiel

TEI0050 Basic Beispiel

TEI0050 Grundlegendes Beispiel

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