PCIe FMC-Carrier mit AMD Virtex™ 7 FPGA, 8 Lane PCIe GEN2, SODIMM SDRAM

2.723,91 €

Artikelnummer: TEC0330-05

Artikelstatus: EOL

Lagerbestand: 4

Produktinformationen "PCIe FMC-Carrier mit AMD Virtex™ 7 FPGA, 8 Lane PCIe GEN2, SODIMM SDRAM"

Dieses Produkt wird vergünstigt angeboten und gilt so lange der Vorrat reicht!
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Der Vorgänger dieses Artikels ist TEC0330-04. Alle Änderungen befinden sich in der Product Change Notification (PCN).

Hinweis: Der Träger ist ohne Auflage für Wärmeableitung!

Das Trenz Electronic TEC0330 ist eine PCI-Express Formfaktorkarte (PCIe 2.0 oder höher) mit einem integriertem AMD Virtex-7 XC7VX330T FPGA Chip. Diese High-End-FPGA-Karte ist für maximale Systemleistung ausgelegt und für den Einsatz in Anwendungen mit hohen Anforderungen an den Systemdurchsatz bestimmt. Es gibt eine SO-DIMM-Buchse für Standard-DDR3 SDRAM Erweiterungsspeichermodule auf der Platine.

Das TEC0330 verfügt über einen HPC (High Pin Count) ANSI/VITA 57.1 kompatiblen FMC-Interface-Anschluss für Standard I/O Mezzanine-Module. Andere On-Board Schnittstellenanschlüsse umfassen JTAG für den Zugriff auf FPGA- und On-Board-Systemcontroller CPLD sowie einen Anschluss mit 5 Hochgeschwindigkeits-I/O-Differenzsignalisierungspaaren.

Der TEC0330 FPGA-Carrier kann als Add-on-Karte in einem PCIe 2.0 oder höherfähigen Host-Systemen verwendet werden, kann aber nicht als eigenständiges Gerät verwendet werden.

Eigenschaften

AMD Virtex-7 FPGA-Modul XC7VX330T-2FFG1157C (kommerzieller Temperaturbereich)
PCI-Express 2.0 x8 Karte mit maximalem Durchsatz von 4 GB/s
FMC High Pin Count (HPC)-Stecker
8 FPGA MGT Lanes auf PCIe Schnittstelle verfügbar
DDR3 SODIMM SDRAM Buchse
256-Mbit (32 MByte) Quad SPI Flash-Speicher (für Konfiguration und Betrieb) zugänglich durch:
- FPGA
- JTAG-Port (SPI indirekt, Busbreite x4)
Externer Takteingang über SMA Koaxialstecker
28 GTH-Transceiver mit jeweils bis zu 13,1 GBit/s Datenübertragungsrate
FPGA-Konfiguration durch:
- JTAG-Anschluss
- SPI Flash-Speicher
Programmierbarer Quad-Taktgenerator
TI LMK04828B Ultra-rauscharme JESD204B-konforme Jitter-Cleaner
On-Board Hochleistungs-DC-DC-Wandler
Bis zu 202 FPGA-I/O-Pins am FMC-Anschluss (bis zu 101 LVDS-Paare möglich)
Systemverwaltung und Leistungssequenzierung
AES-Bit-Stream-Verschlüsselung
eFUSE-Bit-Stream-Verschlüsselung

Andere Bestückungsvarianten zur Kosten- oder Leistungsoptimierung sowie Preise bei Großaufträgen sind auf Anfrage erhältlich.

Entwicklungssupport

Aktuelle Dokumentationen, Design Support-Dateien und Referenzdesigns mit Quelldateien stehen kostenlos zum Download zur Verfügung.

Lieferumfang

1 x TEC0330-05 Trenz Electronic PCIe FMC-Carrier mit AMD Virtex-7 330T FPGA

Zusätzliche Informationen

Artikelnummer des Herstellers: TEC0330-05
Trenz Electronic TEC0330 Wiki
Support Forum

Alle von Trenz Electronic produzierten Module
werden in Deutschland entwickelt und gefertigt.

Eigenschaften "PCIe FMC-Carrier mit AMD Virtex™ 7 FPGA, 8 Lane PCIe GEN2, SODIMM SDRAM"

Eigenschaften

FPGA Hersteller:	AMD
FPGA-/SoC-Architektur:	7 Series
FPGA-/SoC-Familie:	Virtex
FPGA-/SoC-Typ:	FPGA

Angaben gemäß Hersteller. Irrtum und Änderung vorbehalten.

Downloads

File	File-Extension	Description
Bit-File	*.bit	FPGA Configuration File
Diverse Reports	--	Report files in different formats

Komponente	Beschreibung
IP-Interfaces	I2C, ASIO (AXI-Stream to IO), SPI-Flash, Uart

Anwendung	Beschreibung
hello_world	Xilinx Hello World Example

Dateien	Datei-Endung	Beschreibung
MCS-File	*.mcs	Flash Konfigurationsdatei mit Boot-Image (MicroBlaze oder nur FPGA-Teil)
Bit-File	*.bit	FPGA Konfigurationsdatei
Software-Application-File	*.elf	Software Anwendung für Zynq or MicroBlaze Processor Systeme
Hardware-Platform-Specification-Files	*.hdf	Hardware Specification vom the Vivado Project für SDK/HSI
MMI-File	*.mmi	Datei mit Beschreibung der BRAM-Location für die MCS- oder BIT-File Generierung mit *.elf Inhalt (MicroBlaze)
Diverse Reports	--	Report-Dateien in verschiedenen Formaten

Komponente	Beschreibung
Xilinx-IP	I2C,SPI-Flash,UART
TE-IP	ASIO (AXI-Stream to IO)

Anwendung	Beschreibung
hello_world	Xilinx Hello World Example

Dateien	Datei-Endung	Beschreibung
MCS-File	*.mcs	Flash Konfigurationsdatei mit Boot-Image (MicroBlaze oder nur FPGA-Teil)
BIT-File	*.bit	FPGA Konfigurationsdatei
Software-Application-File	*.elf	Software Anwendung für Zynq oder MicroBlaze Processor Systeme
Hardware-Platform-Specification-Files	*.hdf	Exportierte Vivado Hardware Specification für SDK/HSI
MMI-File	*.mmi	Datei mit Beschreibung der BRAM-Location für die MCS- oder BIT-File Generierung mit *.elf Inhalt (MicroBlaze)
Diverse Reports	--	Report-Dateien in verschiedenen Formaten

Komponente	Beschreibung
Xilinx-IP	VIO
TE-IP	Startupe2,LabTools Frequency Counter

Dateien	Datei-Endung	Beschreibung
BIT-File	*.bit	FPGA Konfigurationsdatei
DebugProbes-File	*.ltx	Definition Datei für Vivado/Vivado LabTools Debugging Schnittstelle
Diverse Reports	---	Report-Dateien in verschiedenen Formaten
LabTools Project-File	*.lpr	Vivado Labtools Projekt Datei

Komponente	Beschreibung
Xilinx-IP	VIO (Virtual Input/Output)
TE-IP	Labtools Frequency Counter, Startupe2 Primitive Wrapper

Dateien	Datei-Endung	Beschreibung
BIT-File	*.bit	FPGA Konfigurationsdatei
DebugProbes-File	*.ltx	Definition Datei für Vivado/Vivado LabTools Debugging Schnittstelle
Diverse Reports	---	Report-Dateien in verschiedenen Formaten
LabTools Project-File	*.lpr	Vivado Labtools Projekt Datei
MCS-File	*.mcs	Flash Konfigurationsdatei mit Boot-Image (MicroBlaze oder nur FPGA-Teil)

Komponente	Beschreibung
Interface IPs	DDR3, GPIO, Uart0, QSPI und Ethernet

Anwendung	Beschreibung
hello_world	Xilinx Hello World Example (.elf file only)

Dateien	Datei-Endung	Beschreibung
MCS-File	*.mcs	Flash Konfigurationsdatei mit Boot-Image (MicroBlaze oder nur FPGA-Teil)
Bit-File	*.bit	FPGA Konfigurationsdatei
Software-Application-File	*.elf	Software Anwendung für Zynq or MicroBlaze Processor Systeme
Hardware-Platform-Specification-Files	*.hdf	Hardware Specification vom the Vivado Project für SDK/HSI
MMI-File	*.mmi	Datei mit Beschreibung der BRAM-Location für die MCS- or BIT-File Generierung mit *.elf Inhalt (MicroBlaze)
Diverse Reports	--	Report-Dateien in verschiedenen Formaten

Komponente	Beschreibung
Xilinx-IP	MicroBlaze, MB-Debug, Uartlite, MIG7 for DDR3, QSPI, Timer, Ethernet Lite
TE-IP	ASIO GPIO (AXI-Stream to GPIO)

Anwendung	Beschreibung
Hello World	Xilinx Hello world ( generate elf file only)

Dateien	Datei-Endung	Beschreibung
MCS-File	*.mcs	Flash Konfigurationsdatei mit Boot-Image (MicroBlaze oder nur FPGA-Teil)
BIT-File	*.bit	FPGA Konfigurationsdatei
Software-Application-File	*.elf	Software Anwendung für Zynq oder MicroBlaze Processor Systeme
Hardware-Platform-Specification-Files	*.hdf	Exportierte Vivado Hardware Specification für SDK/HSI
MMI-File	*.mmi	Datei mit Beschreibung der BRAM-Location für die MCS- oder BIT-File Generierung mit *.elf Inhalt (MicroBlaze)
Diverse Reports	--	Report-Dateien in verschiedenen Formaten

Komponente	Beschreibung
Xilinx-IP	VIO,ILA
TE-IP	unio_mac

Dateien	Datei-Endung	Beschreibung
BIT-File	*.bit	FPGA Konfigurationsdatei
DebugProbes-File	*.ltx	Definition Datei für Vivado/Vivado LabTools Debugging Schnittstelle
Diverse Reports	---	Report-Dateien in verschiedenen Formaten
LabTools Project-File	*.lpr	Vivado Labtools Projekt Datei

Komponente	Beschreibung
Interface IPs	QSPI, Uart, ASIO (Axi-Stream to IO)

Anwendung	Beschreibung
hello_world	Xilinx Hello World Example

Dateien	Datei-Endung	Beschreibung
MCS-File	*.mcs	Flash Konfigurationsdatei mit Boot-Image (MicroBlaze oder nur FPGA-Teil)
Bit-File	*.bit	FPGA Konfigurationsdatei
Software-Application-File	*.elf	Software Anwendung für Zynq or MicroBlaze Processor Systeme
Hardware-Platform-Specification-Files	*.hdf	Hardware Specification vom the Vivado Project für SDK/HSI
MMI-File	*.mmi	Datei mit Beschreibung der BRAM-Location für die MCS- or BIT-File Generierung mit *.elf Inhalt (MicroBlaze)
Diverse Reports	--	Report-Dateien in verschiedenen Formaten

Komponente	Beschreibung
Xilinx-IP	ILA, VIO, CLK-Wizard
TE-IP	F32C, Vector_LED, UART_MON

Dateien	Datei-Endung	Beschreibung
BIT-File	*.bit	FPGA Konfigurationsdatei
DebugProbes-File	*.ltx	Definition Datei für Vivado/Vivado LabTools Debugging Schnittstelle
Diverse Reports	---	Report-Dateien in verschiedenen Formaten
LabTools Project-File	*.lpr	Vivado Labtools Projekt Datei
MCS-File	*.mcs	Flash Konfigurationsdatei mit Boot-Image (MicroBlaze oder nur FPGA-Teil)

Komponente	Beschreibung
IP-Interfaces	DDR3, QSPI, Uart, I2C, Ethernet, ASIO (AXI-Stream to IO)

Anwendung	Beschreibung
hello_world	Xilinx Hello World Example (.elf only)

Dateien	Datei-Endung	Beschreibung
MCS-File	*.mcs	Flash Konfigurationsdatei mit Boot-Image (MicroBlaze oder nur FPGA-Teil)
Bit-File	*.bit	FPGA Konfigurationsdatei
Software-Application-File	*.elf	Software Anwendung für Zynq or MicroBlaze Processor Systeme
Hardware-Platform-Specification-Files	*.hdf	Hardware Specification vom the Vivado Project für SDK/HSI
MMI-File	*.mmi	Datei mit Beschreibung der BRAM-Location für die MCS- oder BIT-File Generierung mit *.elf Inhalt (MicroBlaze)
Diverse Reports	--	Report-Dateien in verschiedenen Formaten

Komponente	Beschreibung
Xilinx-IP	AXI Timer, AXI Interrupt Controller,MIG, AXI QSPI, AXI Uart Lite, AXI I2C, AXI Ethernet Lite, VIO
TE-IP	ASIO (AXI-Stream to IO), labtools_fmeter

Anwendung	Beschreibung
hello_world	Xilinx Hello World Example (.elf only)
te_spi_bootloader	SPI Bootloader (.elf only)

Dateien	Datei-Endung	Beschreibung
MCS-File	*.mcs	Flash Konfigurationsdatei mit Boot-Image (MicroBlaze oder nur FPGA-Teil)
BIT-File	*.bit	FPGA Konfigurationsdatei
Software-Application-File	*.elf	Software Anwendung für Zynq oder MicroBlaze Processor Systeme
Hardware-Platform-Specification-Files	*.hdf	Exportierte Vivado Hardware Specification für SDK/HSI
MMI-File	*.mmi	Datei mit Beschreibung der BRAM-Location für die MCS- oder BIT-File Generierung mit *.elf Inhalt (MicroBlaze)
Diverse Reports	--	Report-Dateien in verschiedenen Formaten

Komponente	Beschreibung
Xilinx-IP	AXI Timer, AXI Interrupt Controller,MIG, AXI QSPI, AXI Uart Lite, AXI I2C, AXI Ethernet Lite

Anwendung	Beschreibung
hello_world	Xilinx Hello World Example (.elf only)
memory_tests	Xilinx Memory Example (.elf only)

Dateien	Datei-Endung	Beschreibung
BIT-File	*.bit	FPGA Konfigurationsdatei
Diverse Reports	---	Report-Dateien in verschiedenen Formaten
Hardware-Platform-Specification-Files	*.hdf	Exportierte Vivado Hardware Specification für SDK/HSI
LabTools Project-File	*.lpr	Vivado Labtools Projekt Datei
MCS-File	*.mcs	Flash Konfigurationsdatei mit Boot-Image (MicroBlaze oder nur FPGA-Teil)
MMI-File	*.mmi	Datei mit Beschreibung der BRAM-Location für die MCS- oder BIT-File Generierung mit *.elf Inhalt (MicroBlaze)
Software-Application-File	*.elf	Software Anwendung für Zynq oder MicroBlaze Processor Systeme

Komponente	Beschreibung
Zynq Processor	aktivierte MIO-Interfaces: DDR3, QSPI, GPIO,2x Uart, QSPI,2x I2C,1x SD,1x Ethernet

Anwendung	Beschreibung
zynq_fsbl	Zynq First Stage Bootloader (für HDMI modifiziert und als Library in /sw_lib/ zur Verfügung gestellt)
hello_world	Xilinx Hello World Example

Dateien	Datei-Endung	Beschreibung
Bin-File	*.bin	Flash Konfigurationsdatei mit Boot-Image für Zynq-FPGAs
Bit-File	*.bit	FPGA Konfigurationsdatei
Software-Application-File	*.elf	Software Anwendung für Zynq or MicroBlace Processor Systeme
Hardware-Platform-Specification-Files	*.hdf	Hardware Specification vom the Vivado Project für SDK/HSI
BIF-File	*.bif	Datei mit Beschreibung für die Bin-File Generierung
OS-Image	*.ub	Image mit Linux Kernel (enthält für Petalinux optional auch Devicetree und RAM-Disk)
Diverse Reports	--	Report-Dateien in verschiedenen Formaten

Komponente	Beschreibung
Zynq Processor	aktivierte MIO-Interfaces: DDR3, QSPI, GPIO,2x Uart, QSPI,2x I2C,1x SD,1x Ethernet

Digilent
OHO-Elektronik
Sundance
Trenz_Electronic - Dokumente und Design Daten für Trenz Electronic Produkte
inrevium
reference

TEC0330 PCIe Carrier with Xilinx Virtex-7 and a FMC connector

TEC0330 PCIe FMC Carrier - Wiki with TRM, reference projects, application notes and more
- TEC0330 TRM - Technical Reference Manual
- TEC0330 Reference Designs - Reference Design Description for Vivado 2017.2 and newer
- TEC0330 CPLD Firmware - Firmware Description
- TEC0330 Product Change Notifications - PCN (see also Schematic Change History and TRM)

Links

Shop TEC0330 - contains prices, available stock, disposability, scope of delivery and more
Download area - various reference designs, schematics, hardware designs and more
TE0790 Resources - XMOD JTAG Programmer documentation
Pinout/Tracelength Table - illustration of pinout, tracelength and cross reference Information of modules with different baseboards

Support

For support, please go to http://forum.trenz-electronic.de/ or contact support@trenz-electronic.de

Name	Folder	Description
Source Name	<design_name><folder>	Source Beschreibung
PetaLinux Project	<design_name>/os/petalinux	PetaLinux Project mit Ethernet,USB,RTC

Anwendung	Beschreibung
zynq_fsbl	TE modifizierter Zynq FSBL, siehe te_fsbl_hooks.c (template in sobfolder sw_lib)
hello_te0720	Hello TE0720 Beispiel in Endlosschleife
u-boot	Petalinux-Uboot (image.ub in <design_name>/prebuilt/os/petalinux/<short dir oder default>)

PCIe FMC-Carrier mit AMD Virtex™ 7 FPGA, 8 Lane PCIe GEN2, SODIMM SDRAM

Produktinformationen "PCIe FMC-Carrier mit AMD Virtex™ 7 FPGA, 8 Lane PCIe GEN2, SODIMM SDRAM"

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Vitis AI Referenz Design

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TE0950 Basic Linux Beispiel

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